vec-cmp-01.ll
6.8 KB
1
2
3
4
5
6
7
8
9
10
11
12
13
14
15
16
17
18
19
20
21
22
23
24
25
26
27
28
29
30
31
32
33
34
35
36
37
38
39
40
41
42
43
44
45
46
47
48
49
50
51
52
53
54
55
56
57
58
59
60
61
62
63
64
65
66
67
68
69
70
71
72
73
74
75
76
77
78
79
80
81
82
83
84
85
86
87
88
89
90
91
92
93
94
95
96
97
98
99
100
101
102
103
104
105
106
107
108
109
110
111
112
113
114
115
116
117
118
119
120
121
122
123
124
125
126
127
128
129
130
131
132
133
134
135
136
137
138
139
140
141
142
143
144
145
146
147
148
149
150
151
152
153
154
155
156
157
158
159
160
161
162
163
164
165
166
167
168
169
170
171
172
173
174
175
176
177
178
179
180
181
182
183
184
185
186
187
188
189
190
191
192
193
194
195
196
197
198
199
200
201
202
203
204
205
206
207
208
209
210
211
212
213
214
215
216
217
218
219
220
221
222
223
224
225
226
227
228
; Test v16i8 comparisons.
;
; RUN: llc < %s -mtriple=s390x-linux-gnu -mcpu=z13 | FileCheck %s
; Test eq.
define <16 x i8> @f1(<16 x i8> %dummy, <16 x i8> %val1, <16 x i8> %val2) {
; CHECK-LABEL: f1:
; CHECK: vceqb %v24, %v26, %v28
; CHECK-NEXT: br %r14
%cmp = icmp eq <16 x i8> %val1, %val2
%ret = sext <16 x i1> %cmp to <16 x i8>
ret <16 x i8> %ret
}
; Test ne.
define <16 x i8> @f2(<16 x i8> %dummy, <16 x i8> %val1, <16 x i8> %val2) {
; CHECK-LABEL: f2:
; CHECK: vceqb [[REG:%v[0-9]+]], %v26, %v28
; CHECK-NEXT: vno %v24, [[REG]], [[REG]]
; CHECK-NEXT: br %r14
%cmp = icmp ne <16 x i8> %val1, %val2
%ret = sext <16 x i1> %cmp to <16 x i8>
ret <16 x i8> %ret
}
; Test sgt.
define <16 x i8> @f3(<16 x i8> %dummy, <16 x i8> %val1, <16 x i8> %val2) {
; CHECK-LABEL: f3:
; CHECK: vchb %v24, %v26, %v28
; CHECK-NEXT: br %r14
%cmp = icmp sgt <16 x i8> %val1, %val2
%ret = sext <16 x i1> %cmp to <16 x i8>
ret <16 x i8> %ret
}
; Test sge.
define <16 x i8> @f4(<16 x i8> %dummy, <16 x i8> %val1, <16 x i8> %val2) {
; CHECK-LABEL: f4:
; CHECK: vchb [[REG:%v[0-9]+]], %v28, %v26
; CHECK-NEXT: vno %v24, [[REG]], [[REG]]
; CHECK-NEXT: br %r14
%cmp = icmp sge <16 x i8> %val1, %val2
%ret = sext <16 x i1> %cmp to <16 x i8>
ret <16 x i8> %ret
}
; Test sle.
define <16 x i8> @f5(<16 x i8> %dummy, <16 x i8> %val1, <16 x i8> %val2) {
; CHECK-LABEL: f5:
; CHECK: vchb [[REG:%v[0-9]+]], %v26, %v28
; CHECK-NEXT: vno %v24, [[REG]], [[REG]]
; CHECK-NEXT: br %r14
%cmp = icmp sle <16 x i8> %val1, %val2
%ret = sext <16 x i1> %cmp to <16 x i8>
ret <16 x i8> %ret
}
; Test slt.
define <16 x i8> @f6(<16 x i8> %dummy, <16 x i8> %val1, <16 x i8> %val2) {
; CHECK-LABEL: f6:
; CHECK: vchb %v24, %v28, %v26
; CHECK-NEXT: br %r14
%cmp = icmp slt <16 x i8> %val1, %val2
%ret = sext <16 x i1> %cmp to <16 x i8>
ret <16 x i8> %ret
}
; Test ugt.
define <16 x i8> @f7(<16 x i8> %dummy, <16 x i8> %val1, <16 x i8> %val2) {
; CHECK-LABEL: f7:
; CHECK: vchlb %v24, %v26, %v28
; CHECK-NEXT: br %r14
%cmp = icmp ugt <16 x i8> %val1, %val2
%ret = sext <16 x i1> %cmp to <16 x i8>
ret <16 x i8> %ret
}
; Test uge.
define <16 x i8> @f8(<16 x i8> %dummy, <16 x i8> %val1, <16 x i8> %val2) {
; CHECK-LABEL: f8:
; CHECK: vchlb [[REG:%v[0-9]+]], %v28, %v26
; CHECK-NEXT: vno %v24, [[REG]], [[REG]]
; CHECK-NEXT: br %r14
%cmp = icmp uge <16 x i8> %val1, %val2
%ret = sext <16 x i1> %cmp to <16 x i8>
ret <16 x i8> %ret
}
; Test ule.
define <16 x i8> @f9(<16 x i8> %dummy, <16 x i8> %val1, <16 x i8> %val2) {
; CHECK-LABEL: f9:
; CHECK: vchlb [[REG:%v[0-9]+]], %v26, %v28
; CHECK-NEXT: vno %v24, [[REG]], [[REG]]
; CHECK-NEXT: br %r14
%cmp = icmp ule <16 x i8> %val1, %val2
%ret = sext <16 x i1> %cmp to <16 x i8>
ret <16 x i8> %ret
}
; Test ult.
define <16 x i8> @f10(<16 x i8> %dummy, <16 x i8> %val1, <16 x i8> %val2) {
; CHECK-LABEL: f10:
; CHECK: vchlb %v24, %v28, %v26
; CHECK-NEXT: br %r14
%cmp = icmp ult <16 x i8> %val1, %val2
%ret = sext <16 x i1> %cmp to <16 x i8>
ret <16 x i8> %ret
}
; Test eq selects.
define <16 x i8> @f11(<16 x i8> %val1, <16 x i8> %val2,
<16 x i8> %val3, <16 x i8> %val4) {
; CHECK-LABEL: f11:
; CHECK: vceqb [[REG:%v[0-9]+]], %v24, %v26
; CHECK-NEXT: vsel %v24, %v28, %v30, [[REG]]
; CHECK-NEXT: br %r14
%cmp = icmp eq <16 x i8> %val1, %val2
%ret = select <16 x i1> %cmp, <16 x i8> %val3, <16 x i8> %val4
ret <16 x i8> %ret
}
; Test ne selects.
define <16 x i8> @f12(<16 x i8> %val1, <16 x i8> %val2,
<16 x i8> %val3, <16 x i8> %val4) {
; CHECK-LABEL: f12:
; CHECK: vceqb [[REG:%v[0-9]+]], %v24, %v26
; CHECK-NEXT: vsel %v24, %v30, %v28, [[REG]]
; CHECK-NEXT: br %r14
%cmp = icmp ne <16 x i8> %val1, %val2
%ret = select <16 x i1> %cmp, <16 x i8> %val3, <16 x i8> %val4
ret <16 x i8> %ret
}
; Test sgt selects.
define <16 x i8> @f13(<16 x i8> %val1, <16 x i8> %val2,
<16 x i8> %val3, <16 x i8> %val4) {
; CHECK-LABEL: f13:
; CHECK: vchb [[REG:%v[0-9]+]], %v24, %v26
; CHECK-NEXT: vsel %v24, %v28, %v30, [[REG]]
; CHECK-NEXT: br %r14
%cmp = icmp sgt <16 x i8> %val1, %val2
%ret = select <16 x i1> %cmp, <16 x i8> %val3, <16 x i8> %val4
ret <16 x i8> %ret
}
; Test sge selects.
define <16 x i8> @f14(<16 x i8> %val1, <16 x i8> %val2,
<16 x i8> %val3, <16 x i8> %val4) {
; CHECK-LABEL: f14:
; CHECK: vchb [[REG:%v[0-9]+]], %v26, %v24
; CHECK-NEXT: vsel %v24, %v30, %v28, [[REG]]
; CHECK-NEXT: br %r14
%cmp = icmp sge <16 x i8> %val1, %val2
%ret = select <16 x i1> %cmp, <16 x i8> %val3, <16 x i8> %val4
ret <16 x i8> %ret
}
; Test sle selects.
define <16 x i8> @f15(<16 x i8> %val1, <16 x i8> %val2,
<16 x i8> %val3, <16 x i8> %val4) {
; CHECK-LABEL: f15:
; CHECK: vchb [[REG:%v[0-9]+]], %v24, %v26
; CHECK-NEXT: vsel %v24, %v30, %v28, [[REG]]
; CHECK-NEXT: br %r14
%cmp = icmp sle <16 x i8> %val1, %val2
%ret = select <16 x i1> %cmp, <16 x i8> %val3, <16 x i8> %val4
ret <16 x i8> %ret
}
; Test slt selects.
define <16 x i8> @f16(<16 x i8> %val1, <16 x i8> %val2,
<16 x i8> %val3, <16 x i8> %val4) {
; CHECK-LABEL: f16:
; CHECK: vchb [[REG:%v[0-9]+]], %v26, %v24
; CHECK-NEXT: vsel %v24, %v28, %v30, [[REG]]
; CHECK-NEXT: br %r14
%cmp = icmp slt <16 x i8> %val1, %val2
%ret = select <16 x i1> %cmp, <16 x i8> %val3, <16 x i8> %val4
ret <16 x i8> %ret
}
; Test ugt selects.
define <16 x i8> @f17(<16 x i8> %val1, <16 x i8> %val2,
<16 x i8> %val3, <16 x i8> %val4) {
; CHECK-LABEL: f17:
; CHECK: vchlb [[REG:%v[0-9]+]], %v24, %v26
; CHECK-NEXT: vsel %v24, %v28, %v30, [[REG]]
; CHECK-NEXT: br %r14
%cmp = icmp ugt <16 x i8> %val1, %val2
%ret = select <16 x i1> %cmp, <16 x i8> %val3, <16 x i8> %val4
ret <16 x i8> %ret
}
; Test uge selects.
define <16 x i8> @f18(<16 x i8> %val1, <16 x i8> %val2,
<16 x i8> %val3, <16 x i8> %val4) {
; CHECK-LABEL: f18:
; CHECK: vchlb [[REG:%v[0-9]+]], %v26, %v24
; CHECK-NEXT: vsel %v24, %v30, %v28, [[REG]]
; CHECK-NEXT: br %r14
%cmp = icmp uge <16 x i8> %val1, %val2
%ret = select <16 x i1> %cmp, <16 x i8> %val3, <16 x i8> %val4
ret <16 x i8> %ret
}
; Test ule selects.
define <16 x i8> @f19(<16 x i8> %val1, <16 x i8> %val2,
<16 x i8> %val3, <16 x i8> %val4) {
; CHECK-LABEL: f19:
; CHECK: vchlb [[REG:%v[0-9]+]], %v24, %v26
; CHECK-NEXT: vsel %v24, %v30, %v28, [[REG]]
; CHECK-NEXT: br %r14
%cmp = icmp ule <16 x i8> %val1, %val2
%ret = select <16 x i1> %cmp, <16 x i8> %val3, <16 x i8> %val4
ret <16 x i8> %ret
}
; Test ult selects.
define <16 x i8> @f20(<16 x i8> %val1, <16 x i8> %val2,
<16 x i8> %val3, <16 x i8> %val4) {
; CHECK-LABEL: f20:
; CHECK: vchlb [[REG:%v[0-9]+]], %v26, %v24
; CHECK-NEXT: vsel %v24, %v28, %v30, [[REG]]
; CHECK-NEXT: br %r14
%cmp = icmp ult <16 x i8> %val1, %val2
%ret = select <16 x i1> %cmp, <16 x i8> %val3, <16 x i8> %val4
ret <16 x i8> %ret
}